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vhdl-compiler

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概述

目前只是希望能够对VHDL源文件进行词法分析、语法分析和语义分析，并产生中间格式的输出。至于怎样把这个中间格式的文件映射成芯片或者最终布局的物理划分，则需要在将来完成。

有兴趣一起完成这个项目的可以联系 jiashu888@gmail.com

创建时间：2014-05-11 02:11

项目来源：http://www.ohloh.net/p/vhdl-compiler

标签:

lex

compiler

yacc

vhdl

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